概要
hdLabトレーニング講座の日程です。
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受講のお申込み（購入）は、日程表内の「受付中」をクリックし、フォームよりお申込みください。
また、お申込み（購入）の前に必ず左メニューの「受講規約」をご覧ください。
受講料
- 1日コース ： ￥53,900 (税抜き ￥49,000)
- 2日コース ：￥107,800 (税抜き ￥98,000)
- 3日コース ：￥161,700 (税抜き￥147,000)
開催形態
新横浜会場での対面での開催です。
オンラインでの開催です。
開催日程
申込締切は原則開催日の７営業日前の午後5時です。
| カテゴリ | コース名 | 開催日 | 開催形態 | 状況 |
|---|---|---|---|---|
| ﾃﾞｻﾞｲﾝ ﾌﾛｰ | 検証スクリプト講座 ※オンライン※ | 2025/03/06(木) 10:00～18:00 | | 受付終了 |
| 言語 | Verilog HDL ユーザーのための SystemVerilog による回路記述 ※オンライン※ | 2025/03/07(金) 10:00～18:00 | | 受付終了 |
| ﾃﾞｻﾞｲﾝ ﾌﾛｰ | 設計ｽﾀｲﾙｶﾞｲﾄﾞｾﾐﾅｰ(VHDL版) ※オンライン※ | 2025/03/11(火)～03/12(水) 10:00～18:00 | | 受付終了 |
| 言語 | SystemVerilogｾﾐﾅｰ(入門コース) ※オンライン※ | 2025/03/25(火)～03/26(水) 10:00～18:00 | | 開催中止 |
| 言語 | RTL設計初級(Verilog) | 2025/03/26(水)～03/28(金) 10:00～18:00 | | 受付終了 |
| 言語 | RTL設計初級 実機演習講座 | 2025/4/2(水)～4/4(金) 10:00～18:00 | | 開催中止 |
| 言語 | 実践UVMを使った検証環境構築 | 2025/4/15(火)～4/16(水) 10:00～18:00 | | 受付中 |
| 言語 | 論理回路基礎 | 2025/4/17(木)～4/18(金) 10:00～18:00 | | 受付中 |
| 言語 | SystemVerilogｾﾐﾅｰ(入門コース) | 2025/4/22(火)～4/23(水) 10:00～18:00 | | 受付中 |
| ﾃﾞｻﾞｲﾝ ﾌﾛｰ | 設計ｽﾀｲﾙｶﾞｲﾄﾞｾﾐﾅｰ(Verilog HDL版) ※オンライン※ | 2025/4/24(木)～4/25(金) 10:00～18:00 | | 受付中 |
| 言語 | RTL設計初級(Verilog) | 2025/5/14(水)～5/16(金) 10:00～18:00 | | 受付中 |
| 言語 | RTL設計初級 実機演習講座 | 2025/5/21(水)～5/23(金) 10:00～18:00 | | 受付中 |
| 言語 | SystemVerilogｾﾐﾅｰ(アサーションコース) ※オンライン※ | 2025/5/22(木)～5/23(金) 10:00～18:00 ※日程変更 | | 受付中 |
| ﾃﾞｻﾞｲﾝ ﾌﾛｰ | RTL設計中級 論理合成 | 2025/5/27(火)～5/28(水) 10:00～18:00 | | 受付中 |
| 言語 | SystemCセミナー(入門コース) | 2025/5/29(木)～5/30(金) 10:00～18:00 | | 受付中 |
| ﾃﾞｻﾞｲﾝ ﾌﾛｰ | 検証スクリプト講座 ※オンライン※ | 2025/6/12(木) 10:00～18:00 | | 受付中 |
| 言語 | Verilog HDL ユーザーのための SystemVerilog による回路記述 ※オンライン※ | 2025/6/13(金) 10:00～18:00 | | 受付中 |
| ﾃﾞｻﾞｲﾝ ﾌﾛｰ | RTL設計中級 機能検証 ※オンライン※ | 2025/6/24(火)～6/25(水) 10:00～18:00 | | 受付中 |
| 言語 | RTL設計初級(Verilog) | 2025/6/25(水)～6/27(金) 10:00～18:00 | | 受付中 |
| 言語 | 実践UVMを使った検証環境構築 | 2025/6/17(火)～6/18(水) 10:00～18:00 | | 受付中 |