IP インテグレーターツールによる設計
| カテゴリ画像 | Courseへのリンク | 日程 | 会場、受講料 | 状況 | category | 開催月 | 締切時間 | Flag |
|---|---|---|---|---|---|---|---|---|
| Vivado.png | Vivado Design Suite でのタイミング制約と解析 | 5月8日(水) 申込締切日：4/24 10:00~17:30 | オンライン TC：4TC 現金：¥53,900 | 1575 | FPGAデバイス&ツールコース | 2024年5月 | 202404241700 | 1 |
| Vivado.png | Vivado Design Suite でのタイミング クロージャ | 5月9日(木) 申込締切日：4/25 10:00~17:30 | オンライン TC：4TC 現金：¥53,900 | 1576 | FPGAデバイス&ツールコース | 2024年5月 | 202404251700 | 1 |
| AdovancedMin2.png | VITISアクセラレーション開発 | 5月14日(火)-15日(水) 申込締切日：5/1 10:00~18:00 | オンライン TC：12TC 現金：¥132,000 | 開催中止 | アドバンスドコース | 2024年5月 | 202405011700 | 0 |
| embe.png | Zynq SoC エンベデッドシステム開発 | 5月16日(木)-17日(金) 申込締切日：5/7 10:00~18:00 | オンライン TC：8TC 現金：¥107,800 | 1578 | エンベデッドコース | 2024年5月 | 202405071700 | 1 |
| AdovancedMin2.png | Zynq UltraScale+ MPSoC ハードウェアデザイン | 5月21日(火) 申込締切日：5/10 10:00~18:00 | オンライン TC：6TC 現金：¥66,000 | 1579 | アドバンスドコース | 2024年5月 | 202405101700 | 1 |
| AdovancedMin2.png | Kria KV260 入門 | 5月22日(水) 申込締切日：5/13 13:00~18:00 | 新横浜(hdLab) TC：8TC ※TCのみ | 1580 | アドバンスドコース | 2024年5月 | 202405131700 | 1 |
| CONN.png | PCI Express デザイン | 5月23日(木)-24日(金) 申込締切日：5/14 10:00~17:30 | オンライン TC：12TC 現金：¥132,000 | 1581 | 高速インターフェイスコース | 2024年5月 | 202405141700 | 1 |
| AdovancedMin2.png | Kria KV260 Vision AI | 5月28日(火)-29日(水) 申込締切日：5/17 10:00~18:00 | オンライン TC：12TC 現金：¥132,000 | 1582 | アドバンスドコース | 2024年5月 | 202405171700 | 1 |
| Vivado.png | [Verilog] Xilinx/Vivadoツールを使ったRTL設計初級 | 5月30日(木)-31日(金) 申込締切日：5/21 10:00~18:00 | オンライン TC：8TC 現金：¥107,800 | 1583 | FPGAデバイス&ツールコース | 2024年5月 | 202405211700 | 1 |
| embe.png | Embedded Systems Software Design Basic | 6月5日(水)-6日(木) 申込締切日：5/27 10:00~18:00 | 新横浜(hdLab) TC：12TC 現金：¥132,000 | 1585 | エンベデッドコース | 2024年6月 | 202405271700 | 1 |
| embe.png | Embedded Systems Software Design OS | 6月7日(金) 申込締切日：5/29 10:00~18:00 | 新横浜(hdLab) TC：6TC 現金：¥66,000 | 1586 | エンベデッドコース | 2024年6月 | 202405291700 | 1 |
| Vivado.png | タイミングクロージャテクニックPart1 | 6月6日(木) 申込締切日：5/28 10:00~17:30 | オンライン TC：6TC 現金：¥66,000 | 1587 | FPGAデバイス&ツールコース | 2024年6月 | 202405281700 | 1 |
| Vivado.png | タイミングクロージャテクニックPart2 | 6月7日(金) 申込締切日：5/29 10:00~17:30 | オンライン TC：6TC 現金：¥66,000 | 1588 | FPGAデバイス&ツールコース | 2024年6月 | 202405291700 | 1 |
| Vivado.png | IP インテグレーターツールによる設計 | 6月11日(火) 申込締切日：5/31 10:00~17:30 | オンライン TC：6TC 現金：¥66,000 | 1589 | FPGAデバイス&ツールコース | 2024年6月 | 202405311700 | 1 |
| AdovancedMin2.png | OS and Hypervisors in Adaptive SoCs | 6月11日(火)-12日(水) 申込締切日：5/31 10:00~18:00 | 新横浜(hdLab) TC：12TC 現金：¥132,000 | 1590 | アドバンスドコース | 2024年6月 | 202405311700 | |
| AdovancedMin2.png | Zynq UltraScale+ MPSoC Boot and Platform Management | 6月13日(木)-14日(金) 申込締切日：6/4 10:00~18:00 | 新横浜(hdLab) TC：12TC 現金：¥132,000 | 1591 | アドバンスドコース | 2024年6月 | 202406041700 | |
| embe.png | PetaLinuxツールを使用したエンベデッドデザイン | 6月18日(火)-19日(水) 申込締切日：6/7 10:00~18:00 | 新横浜(hdLab) TC：8TC 現金：¥107,800 | 1592 | エンベデッドコース | 2024年6月 | 202406071700 | |
| Vivado.png | Vivado Design Suite でのFPGA設計導入 | 6月20日(木)-21日(金) 申込締切日：6/11 10:00~17:30 | 新横浜(hdLab) TC：8TC 現金：¥107,800 | 1593 | FPGAデバイス&ツールコース | 2024年6月 | 202406111700 | |
| Vivado.png | Verification with SystemVerilog | 6月20日(木)-21日(金) 申込締切日：6/11 10:00~18:00 | オンライン TC：8TC 現金：¥107,800 | 1594 | FPGAデバイス&ツールコース | 2024年6月 | 202406111700 | |
| embe.png | Migrating to the Vitis Unified IDE | 6月24日(月) 申込締切日：6/13 10:00~18:00 | 新横浜(hdLab) TC：6TC 現金：¥66,000 | 1599 | エンベデッドコース | 2024年6月 | 202406131700 | 1 |
| Vivado.png | Vivado ロジック解析を使用したデバッグ 基礎編 | 6月25日(火) 申込締切日：6/14 10:00~17:30 | 新横浜(hdLab) TC：4TC 現金：¥53,900 | 1595 | FPGAデバイス&ツールコース | 2024年6月 | 202406141700 | |
| AdovancedMin2.png | Versal adaptive SoC: Quick Start | 6月26日(水) 申込締切日：6/17 10:00~18:00 | オンライン TC：6TC 現金：¥66,000 | 1598 | アドバンスドコース | 2024年6月 | 202406171700 | 1 |
| AdovancedMin2.png | VitisAIプラットフォーム | 6月27日(木)-28日(金) 申込締切日：6/18 10:00~18:00 | オンライン TC：12TC 現金：¥132,000 | 1596 | アドバンスドコース | 2024年6月 | 202406181700 | |
| Vivado.png | [VHDL] Xilinx/Vivadoツールを使ったRTL設計初級 | 6月27日(木)-28日(金) 申込締切日：6/18 10:00~18:00 | オンライン TC：8TC 現金：¥107,800 | 1597 | FPGAデバイス&ツールコース | 2024年6月 | 202406181700 | |
| Vivado.png | Vivado Design Suite を使用したArtix-7 FPGA設計・開発入門 | 7月2日(火) 申込締切日：6/21 10:00~17:30 | 新横浜(hdLab) TC：4TC 現金：¥53,900 | 1601 | FPGAデバイス&ツールコース | 2024年7月 | 202406211700 | 1 |
| embe.png | ARTYを使用したMicroBlaze開発入門 | 7月3日(水) 申込締切日：6/24 10:00~17:30 | 新横浜(hdLab) TC：4TC 現金：¥53,900 | 1602 | エンベデッドコース | 2024年7月 | 202406241700 | 1 |
| Vivado.png | Vivado Design Suite でのUltraFast設計手法 | 7月4日(木) 申込締切日：6/25 10:00~17:30 | オンライン TC：4TC 現金：¥53,900 | 1603 | FPGAデバイス&ツールコース | 2024年7月 | 202406251700 | 1 |
| Vivado.png | Vivado Design Suite でのインプリメント手法 | 7月5日(金) 申込締切日：6/26 10:00~17:30 | オンライン TC：4TC 現金：¥53,900 | 1604 | FPGAデバイス&ツールコース | 2024年7月 | 202406261700 | 1 |
| DSP.png | Vitis HLSを使った高位合成 | 7月9日(火)-10日(水) 申込締切日：6/28 10:00~18:00 | オンライン TC：12TC 現金：¥132,000 | 1605 | DSPコース | 2024年7月 | 202406281700 | 1 |
| embe.png | Zynq SoC システムアーキテクチャ | 7月11日(木)-12日(金) 申込締切日：7/2 10:00~18:00 | オンライン TC：8TC 現金：¥107,800 | 1606 | エンベデッドコース | 2024年7月 | 202407021700 | 1 |
| Vivado.png | Vivado Design Suite でのパーシャルリコンフィギュレーション | 7月17日(水) 申込締切日：7/5 10:00~17:30 | 新横浜(hdLab) TC：4TC 現金：¥53,900 | 1607 | FPGAデバイス&ツールコース | 2024年7月 | 202407051700 | 1 |
| Vivado.png | [Verilog] Xilinx/Vivadoツールを使ったRTL設計初級 | 7月18日(木)-19日(金) 申込締切日：7/8 10:00~18:00 | オンライン TC：8TC 現金：¥107,800 | 1608 | FPGAデバイス&ツールコース | 2024年7月 | 202407081700 | 1 |
| AdovancedMin2.png | Kria KV260 入門 | 7月19日(金) 申込締切日：7/9 13:00~18:00 | 新横浜(hdLab) TC：8TC （TCのみ） | 1609 | アドバンスドコース | 2024年7月 | 202407091700 | 1 |
| AdovancedMin2.png | Zynq UltraScale+ MPSoC ｼｽﾃﾑｱｰｷﾃｸﾁｬ | 7月23日(火)-24日(水) 申込締切日：7/11 10:00~18:00 | オンライン TC：12TC 現金：¥132,000 | 1610 | アドバンスドコース | 2024年7月 | 202407111700 | 1 |
| Vivado.png | FPGA向けRTL設計スタイルガイドセミナー | 7月25日(木)-26日(金) 申込締切日：7/16 10:00~18:00 | 新横浜(hdLab) TC：8TC 現金：¥107,800 | 1611 | FPGAデバイス&ツールコース | 2024年7月 | 202407161700 | 1 |
| Vivado.png | Vivado Design Suite でのFPGA設計導入 | 7月30日(火)-31日(水) 申込締切日：7/19 10:00~17:30 | オンライン TC：8TC 現金：¥107,800 | 1612 | FPGAデバイス&ツールコース | 2024年7月 | 202407191700 | 1 |
このコースでは、IP インテグレーター ツールの機能を学習します。Vivado® Design Suite を使用してさまざまな ブロック デザインの開発、実装、デバッグが可能になります。
このコースの重点は次のとおりです。
▪ Vivado Design Suite を使用した IPI ブロック デザインの作成
▪ IP パッケージ フローによる独自のカスタム IP の作成
テキストには以下も含まれます。
▪ IP インテグレーターを使用して Versal® ACAP CIPS ブロックを追加および設定し、生成されたプログラマブル デバイス イメージ (PDI) をエクスポートします。
| コース名 | IP インテグレーターツールによる設計 |
|---|---|
| ソフトウェアツール | Vivado Design Suite 2022.1, Vitis 2022.1 |
| トレーニング期間 | 1日間 |
| 受講料 | 1名様 6TC or 66,000円(税込) |
| 受講対象者 | ▪ソフトウェアおよびハードウェア開発者、システム アーキテクト、 Vivado Design Suite IP インテグレーター ツールについて知りたい方 |
| 受講要件 | ▪ FPGA および Vivado Design Suite の基本的な知識 |
| コース内容 | Vivado IP カタログ ▪ Vivado IP フロー IP インテグレーター ▪ IP インテグレーターによる設計 ▪ Vivado IP インテグレーター内のブロックデザインコンテナ ▪ カスタム IP の作成とパッケージ化 ▪ Vivado IP インテグレーター使用によるハードウェア プラットフォーム開発 デバッグ ▪ IP インテグレーター ブロック設計におけるデバッグフロー バージョン コントロールシステム ▪ Vivado Design Suite におけるリビジョン管理システム Manage IP ▪ リモートロケーションにおける IP の管理 |